FILLERC LVS错误【已解决】

jietian · 发表于 2012-12-27 19:40:17

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本帖最后由 jietian 于 2012-12-28 16:33 编辑

在导出gds 做LVS时，FILLERC在版图里识别为管子，但是网表里却没有定义，这种错误怎么改啊？？？

onlykals · 发表于 2012-12-27 22:06:19

在lvs的spice 新增一個dcap , 然後填上個數
應該能對上

jietian · 发表于 2012-12-28 09:49:34

回复 2# onlykals

个数该怎么填啊求赐教！

damonzhao · 发表于 2012-12-28 11:31:23

用的什么PR工具？

jietian · 发表于 2012-12-28 12:29:50

回复 4# damonzhao

encounter,导出的网表都没有FILLERC 。。

陈涛 · 发表于 2012-12-28 12:42:04

1）查导出命令的选项，是否可以强制要求导出某些物理cell
2）导出def，找出里面所有的filler，写回到网表中

damonzhao · 发表于 2012-12-28 13:40:14

对，不管是EDI还是ICC，你都可以输出verilog的时候可以把某些physical单元导出的

jietian · 发表于 2012-12-28 14:43:38

回复 7# damonzhao

多谢两位版主。可以强制导出，但是导出后LVS那些fillerc反而报错说no matching .SUBCKT...

conniezhou · 发表于 2012-12-28 14:55:10

如果在.v 里面包含一些std filler or io filler ，对应的lvs netlist 就要有.subckt
如果std filler or io filler 里面都是没有电路连接，可以写一个空的.subckt ，然后用lvs box 。
例如： .SUBCKT FILL1 VDD VSS
.ends
calibre lvs command 中对应 LVS BOX FILL1

tiogil · 发表于 2012-12-28 16:24:01

回复 1# jietian

把管子加个RODMY层,就不当成是device了

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