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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 设计讨论 › 12bit 100MHz pipelined ADC设计直播
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楼主: mouseliu

[原创] 12bit 100MHz pipelined ADC设计直播

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hubertyue
发表于 2013-4-11 17:45:51 | 显示全部楼层
采用1.5bit的时候，Gideal=2，(Gideal-G)/Gideal的3sigma值为3*sqrt(2)/2*sigma。
G=(Cf+Cs)/Cf=1+(Cs/Cf)               Gideal=2 (Cs=Cf)
如楼主的推导，G的误差3sigma就是(Cs/Cf)的3sigma误差，是sqrt(2)*3*sigma   
所以      ，(Gideal-G)/Gideal的3sigma值为3*sqrt(2)/2*sigma
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mainhand
发表于 2013-4-27 22:16:59 | 显示全部楼层
楼主啥时候继续啊？
其中DNL的计算公式不明白，能详细点吗？？？
另外，关于MDAC的OP Noise有详细的计算吗？望指教！！
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mainhand
发表于 2013-4-27 22:18:27 | 显示全部楼层
楼主的共享精神值得赞扬！！而且ADC设计整的很明白！！向楼主学习！
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ELDO
发表于 2013-4-27 23:33:46 | 显示全部楼层
good one! keep going
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513331385
发表于 2013-5-3 20:16:18 | 显示全部楼层
回复 96# mouseliu

请问楼主你的采样保持电路是用的什么结构啊，我看你的采样波形相当的好啊。。有什么好的参考资料没？
谢谢。
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513331385
发表于 2013-5-3 20:20:19 | 显示全部楼层
请问楼主你的采样保持电路是用的什么结构啊，我看你的采样波形相当的好啊。。有什么好的参考资料没？
谢谢。
我用的电容翻转型，但是运放输入端单端的共模电平相当的不好，但输出不错，只有几个毫伏误差。
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zdl1986
发表于 2013-5-4 12:06:17 | 显示全部楼层
支持楼主，论坛中需要楼主这种无私和开放的人
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noiseless
发表于 2013-5-4 12:12:28 | 显示全部楼层
sampling cap seems too large.
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鱼在水中飞
发表于 2013-5-5 19:38:29 | 显示全部楼层
大赞LZ开放分享的精神。请问LZ如何实现SHA 和 MDAC1 的电容共享？？？
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semico_ljj
发表于 2013-5-5 20:28:01 | 显示全部楼层
mark，
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