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[求助] 请教异步时钟的问题

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发表于 2012-9-5 09:40:15 | 显示全部楼层 |阅读模式

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我这有这样一个需求:113Mhz的数据存入SRAM中,52Mhz的时钟往外取。我想在SRAM前用一个FIFO1,113M往里写;在SRAM后面用一个FIFO2,52M往外读。可是512k*16bit的sram最高速度是100Mhz。这时序怎么能串开呢????按理论上说,如果SRAM一直没闲着,一直读或一直写是能满足时序需求的,可是现在我能力受限,没想到什么好的方法。这个是用到VGA上面的,1024*768@100hz 降频到50hz,所以SRAM中需要存一帧图像。请大家帮帮忙了~谢谢!
 楼主| 发表于 2012-9-10 10:15:41 | 显示全部楼层
啦啦啦,有没有人能帮个忙,还是想不太明白呢
发表于 2012-9-10 11:41:31 | 显示全部楼层
如果用113MHz/2的时钟,每次存32bit的数据呢
发表于 2012-9-10 11:46:29 | 显示全部楼层
另外,我以前有试过,用两个FIFO,每个FIFO只存半帧图像,写一个读一个,乒乓操作,两个FIFO一个写的奇数行一个写的偶数行,如果是视频播放的话基本看不出来图像有坏的地方
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