verilog设计风格的问题

holliwood · 发表于 2012-6-6 16:24:01

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本帖最后由 holliwood 于 2012-6-7 23:46 编辑

always@(posedge clk or negedge rst_n)
if(!rst_n)
else
这样写是不是不好，nlint检查时总是报warning说rst_n既是reset信号又是置位信号，如果必须要用复位置数应该怎么写

duan_dzj · 发表于 2012-6-7 09:01:57

初看没有问题哦。但是你下面是如何写的很关键了。最好写全。

holliwood · 发表于 2012-6-7 12:50:30

回复 2# duan_dzj 就是if（！rst_n）下面对一个寄存器赋初值了

zongkai2003 · 发表于 2012-6-7 16:40:20

回复 1# holliwood

rst_n==1'b0

sh_dong1 · 发表于 2012-6-7 16:48:41

本帖最后由 sh_dong1 于 2012-6-7 17:14 编辑

rst_n==1'b0?赋值用<=
一般没人会在这里对rst_n赋值吧？rst_n作为复位信号可以在这里直接赋值么？不是太明白
期待高人解答

holliwood · 发表于 2012-6-7 23:40:55

回复 4# zongkai2003
试过效果是一样的

holliwood · 发表于 2012-6-7 23:41:47

回复 5# sh_dong1
那个是判断，不是赋值

Timme · 发表于 2012-6-8 08:07:58

这两个检查规则没必要启用。

“复位”成0是reset，“复位”成1是set（或称preset）。下面那个报警是指rst_n为低时有些寄存器被置0，有些被置1。

sh_dong1 · 发表于 2012-6-8 08:48:17

回复 7# holliwood

不好意思，看错了，还以为说的是if(!rst_n)

rst_n==1'b0;

SKILLER · 发表于 2012-6-8 09:18:01

没有什么问题，本来就是把它当异步复位信号来使用，只不过是你的复位的值不一定都是0，可能也有1。这些warning不要紧的！

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