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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 暴多的verilog设计实例，均有原代码！！
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楼主: zhentizhi

暴多的verilog设计实例，均有原代码！！

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liu8033
发表于 2008-11-25 09:07:01 | 显示全部楼层
感谢分享！！！！
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发表于 2008-11-25 10:13:29 | 显示全部楼层
十分感谢~~~~~
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dk5651
发表于 2008-11-25 19:35:15 | 显示全部楼层
呵呵，谢谢啦。。。。
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dk5651
发表于 2008-11-25 19:42:54 | 显示全部楼层
谢谢啦。。。呵呵  。。。
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发表于 2008-11-25 20:13:41 | 显示全部楼层
lz辛苦了
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samkid
发表于 2008-11-26 01:16:26 | 显示全部楼层
看看吧。。。。。。。。。
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samkid
发表于 2008-11-26 01:17:43 | 显示全部楼层
谢谢、、、、、、、、、
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发表于 2008-11-26 15:43:39 | 显示全部楼层
牛人ar~ 頂~
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发表于 2008-11-27 03:20:19 | 显示全部楼层

@@

也没什么嘛
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发表于 2008-12-2 19:34:16 | 显示全部楼层

good

very good
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