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如题,DFTC综合时提示 the current design contains unmapped components的warning是怎么回事呀?
我的design非常简单
module test(
clk,
res,
a,
b,
scan_en//,
// test_mode
);
input clk;
input res;
input scan_en;
//input test_mode;
input[2:0] a;
output[2:0] b;
reg[2:0] b;
reg[2:0] c;
reg[2:0] aa;
always@(posedge clk or posedge res)
if(res)
begin
b<=0;
c<=0;
aa<=0;
end
else
begin
aa<=a;
c[0]<=!(aa[0]&aa[1]);
c[1]<=aa[1]^aa[2];
c[2]<=(aa[0]&aa[1])&aa[2];
b[0]<=!(c[0]&c[1]);
b[1]<=c[1]^c[2];
b[2]<=(c[0]&c[1])&c[2];
end
endmodule
本人超级菜鸟一枚,正在逐渐摸索中,求各位大侠帮忙呀~~~~ |
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