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查看: 2105|回复: 4

[求助] 其他条件一样,仿真ADC信噪比得到3VDD居然比3.6VDD好?why?

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发表于 2012-4-26 01:10:09 | 显示全部楼层 |阅读模式

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工艺是SMIC18.采用3.3VDD。3.6V时。SNR=56dB.3V时,SNR=60以上。求解。
发表于 2012-4-26 01:46:20 | 显示全部楼层
可能是你的某些biasing在3.3V时比3.6V好。或者某些transistor leakage在3.6V下过大,比如vds过大,导致rds减小。check下,transistor的vds有没有超过1.8V的。
发表于 2012-4-26 10:30:53 | 显示全部楼层
回复 1# 居里先生


   可能是静态工作点发生了变化,有可能是你的电路中某些管子处于临界饱和状态,电源电压发生变化导致了其他地方的变化,比如共模输出点的变化,从而使得电路状态发生改变。
发表于 2013-1-16 16:05:47 | 显示全部楼层
楼主能具体说下是怎么测SNR的吗
发表于 2013-1-16 19:29:45 | 显示全部楼层
我也是smic,在ss下发现2.7比3好,跟lz趋势一样
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