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[求助] ddr2的local ready 信号始终为低

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yihaibo007

发表于 2012-2-11 14:07:03 | 显示全部楼层 |阅读模式

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使用altera FPGA的ddr2 ip核，全速率，166.67MHz。突发读写长度均为8，32bit。
写起始地址为0x3200000,每次当地址写到0x32013880时，
开始读，读的起始地址0x3200000，有数出现问题如下：
当读出0x3200038地址的数据之后，local ready 信号变为低，且始终不能变为高！
求高人指点，不胜感激！！！

local, 不胜感激, 信号

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