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楼主: ajuehe

[求助] 求教关于FPGA中的clock skew 的问题

楼主| 发表于 2011-12-21 00:12:31 | 显示全部楼层

8楼说的：altera的话就在assignment里家clock setting和global clk的约束，xilinx的话就用原语BUFG约束在rtl的code中就可以了。
是什么意思，我搞不懂，望赐教，谢谢！

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