ISE中XST综合工具优化了我的reg信息，怎么防止优化

wangbo19852008 · 发表于 2011-9-26 16:52:05

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注意我问的是在XST中不是在Qii或者synplify中，在后两者当中可以通过reg a /*synthesis noprune*/;
wire a /*synthesis keep*/; 此为Verilog语法的综合约束。但是ISE的综合防优化约束我不知道，哪位大虾给
帮帮忙啊！谢谢了！

110500623 · 发表于 2011-9-26 17:15:18

可以试下(* KEEP="TRUE" *)

godwilldie · 发表于 2013-2-1 09:15:07

/* synthesis syn_keep=1 */

云海孤鸿 · 发表于 2013-3-9 11:35:38

用Xilinx原语

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