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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端资料区 › ICC:Clock Gating Methodology for Power and CTS QoR

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楼主: xiedong

[资料] ICC:Clock Gating Methodology for Power and CTS QoR

发表于 2011-8-21 10:36:28 | 显示全部楼层

下来看看

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发表于 2011-8-22 00:04:32 | 显示全部楼层

thanks

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发表于 2011-9-15 23:51:44 | 显示全部楼层

thanks , that's a ppt file, it contains many main technical

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发表于 2011-12-1 22:23:35 | 显示全部楼层

不错的东西！

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发表于 2011-12-2 00:36:13 | 显示全部楼层

这个如和

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发表于 2012-2-3 15:03:08 | 显示全部楼层

回复 1# xiedong

great

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发表于 2012-2-14 17:15:42 | 显示全部楼层

Thanks.

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发表于 2012-2-15 09:55:30 | 显示全部楼层

看样子，貌似很厉害。弄过来看看。

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发表于 2012-6-24 20:04:13 | 显示全部楼层

顶一下！

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发表于 2012-6-25 11:11:32 | 显示全部楼层

thakns for shairng

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