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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端资料区 › ICC:Clock Gating Methodology for Power and CTS QoR
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[资料] ICC:Clock Gating Methodology for Power and CTS QoR

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xiedong
发表于 2011-3-18 22:55:50 | 显示全部楼层 |阅读模式

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synopsys clock gating methodology
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lujunfeng111
发表于 2011-3-19 10:37:09 | 显示全部楼层
一篇技术文档？
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nenclatjoyin
发表于 2011-3-19 13:44:50 | 显示全部楼层
非常感谢
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scorpion
发表于 2011-3-19 14:31:39 | 显示全部楼层
thanks a lot
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anenas
发表于 2011-4-8 01:56:29 | 显示全部楼层
thanks
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damonzhao
发表于 2011-5-9 16:49:15 | 显示全部楼层
很好很强大，多谢
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映山红啊
发表于 2011-8-4 23:16:00 | 显示全部楼层
thanks a lot!
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ggouhwpb
发表于 2011-8-10 13:15:25 | 显示全部楼层
kankanbazaide
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tomyer
发表于 2011-8-10 13:20:40 | 显示全部楼层
thank you !!!
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happy_1q
发表于 2011-8-20 17:03:00 | 显示全部楼层
学习...
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