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[求助] 请问DC综对“*”综合出的乘法器可以是补码乘法器吗?

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发表于 2010-10-22 22:52:04 | 显示全部楼层 |阅读模式

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请问DC综对“*”综合出的乘法器可以是补码乘法器吗?如果可以的话,怎样设置呢,高手请指点!急待回复!
 楼主| 发表于 2010-10-23 19:15:24 | 显示全部楼层
静待高手指点!
发表于 2010-10-23 23:08:48 | 显示全部楼层
求助啊啊啊啊
 楼主| 发表于 2010-10-24 10:39:09 | 显示全部楼层
就没人知道吗?依然静待高手出现!
发表于 2011-5-18 11:24:32 | 显示全部楼层
表示期待结果。
发表于 2011-5-18 15:11:17 | 显示全部楼层
$signed(a)*$signed(b)
综合结果就是有符号数
 楼主| 发表于 2011-6-10 17:55:23 | 显示全部楼层
回复 6# MOSFET


    请问一下,这里的a,b是什么类型的数据呢,综合出来是补码乘法器吗,还是别的,看这个表达式不像,这个表达式跟先对ab求原码,再乘法,再求补码是不是一样的效果呢?
发表于 2011-6-10 19:39:09 | 显示全部楼层
不是都是补码表示的吗
发表于 2011-6-13 10:11:05 | 显示全部楼层
回复 7# wangxuede220


   a,b就是补码形式的有符号数。
发表于 2011-6-13 10:14:12 | 显示全部楼层
6#所说的公式里面a和b可以是reg wire 甚至是port。verilog2001里面这些东西都可以声明是有符号的。例如 reg signed [7:0] a. 这样a就被认为是一个有符号的如果a和b都被声明为有符号的则 c=a+b。这个加法计算就被认为是有符号计算,也就是补码计算。如果a或b其中一个声明时没有加signed标记,即默认为无符号的,则a+b就按照无符号加法来算。此时如果要进行有符号加法就需要在计算中强制声明,像6楼那样。
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