请问大家VerilogA与verilog AMS有何区别

flywb · 发表于 2010-8-23 17:09:58

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刚开始学这个，有点疑问，谢谢大家帮忙～～

panahu · 发表于 2010-8-23 20:34:19

等待解答

icetop · 发表于 2010-8-23 22:37:42

Verilog-A : only support the behavior model for analog design
Verilog-AMS: verilog-D + verilog-A + mixed-signal model => refer: http://www.vhdl.org/verilog-ams/

flywb · 发表于 2010-8-24 09:41:19

3# icetop
谢谢！！

wxwttf · 发表于 2010-8-24 16:46:11

受益~~~~~~

mainhand · 发表于 2010-8-31 09:04:36

各种verilogA的例子

miyusheu · 发表于 2010-9-10 13:28:33

感謝分享喔..........

lylnk · 发表于 2010-9-10 14:04:02

建议用verilogAMS的语句写新东西

估计你有veriloga更新可能少了。现在cadence用veriloga仿真都在提示某某指令verilgams不支持，建议换成verilogams支持的某某指令。

wangtaoic123 · 发表于 2010-9-21 14:30:04

hao dong xo

coolfall · 发表于 2010-9-21 22:20:36

谢谢3楼的

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