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楼主 |
发表于 2010-7-22 18:08:42
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你也说了,复位信号是异步的,那么它就不需要被同步,他和几个时钟域关系不大吧?因为他对一个时钟域来说是异步的,对两个时钟域分别看同样也是分别异步的,不需要同步。同步是针对一个时钟域中的同步信号要进入到另 ...
yohuang 发表于 2010-7-22 17:41
首先谢谢你的答复。
不过我感觉你说的和我想问的好像不是一个意思,当然也可能是我理解差了,请批评指正。
我说的异步复位,是指在模块中像下面这样的代码:
always @ (posedge clk or negedge rst)
begin .... end
在这种复位模式下,一般而言是要加入一个synchronizer,代码如下所示:
reg syn_rst, rff1;
always @ (posedge CLK or negedge RESET)
if (!RESET) {syn_rst, rff1} <= 2'b0;
else {syn_rst, rff1} <= {rff1, 1'b1};
加入这个synchronizer的目的,是为了避免带复位端口的触发器出现recovery/removal的violation,从而引发的亚稳态的问题。
那如果我这个module有两个时钟输入端口,对于每个时钟端口插入一个synchronizer,然后这两个synchronizer共用一个从reset端口引入的reset信号,这两个时钟端口对应的时钟周期不妨称为clk1和clk2。那么插入的两个synchronizer的输出的复位信号相比较于从模块的reset端口引入的复位信号就要分别延迟上两个clk1和clk2的周期,由于clk1和clk2的周期和相位的不同,就导致这两个时钟域对应的触发器的完成复位的时间不同,这在我做的这个项目中应该是不允许的。在这种情况下,该如何去处理reset信号呢?
表达的比较冗长,有劳指正。 |
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