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楼主: nano_dv

[资料] Simulating Verilog RTL using Synopsys VCS

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dp2011

发表于 2011-4-14 22:08:53 | 显示全部楼层

回复 1# sunjianty

thanks

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dp2011

发表于 2011-4-14 22:10:44 | 显示全部楼层

thanks agains

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oppo_11

发表于 2011-4-17 09:46:42 | 显示全部楼层

xiexie

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nishuidegou

发表于 2011-5-29 19:22:53 | 显示全部楼层

xiexiefenxiang

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molteza

发表于 2011-5-30 14:59:19 | 显示全部楼层

GOOD THEATER/
IT CAN BE USE TO SIMULATE SYSTEM C SIMULATION...

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lint123

发表于 2011-6-4 11:19:40 | 显示全部楼层

回复 4# xuzhenli

cool

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call4me

发表于 2011-6-18 01:01:21 | 显示全部楼层

谢谢楼主!!!

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hollyarm

发表于 2011-7-5 03:20:29 | 显示全部楼层

谢谢楼主!!!!

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lca6

发表于 2011-7-5 12:27:25 | 显示全部楼层

下来瞧瞧

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llh1119

发表于 2011-7-22 20:03:09 | 显示全部楼层

thank you very much

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