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楼主: nano_dv

[资料] Simulating Verilog RTL using Synopsys VCS

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发表于 2011-11-22 14:59:22 | 显示全部楼层
下来瞧瞧
发表于 2011-11-23 20:36:33 | 显示全部楼层
回复 1# sunjianty


   不错学习了
发表于 2011-11-23 20:38:11 | 显示全部楼层
求一份详细教程
发表于 2011-11-29 17:52:53 | 显示全部楼层
O(∩_∩)O谢谢
发表于 2012-3-14 13:00:10 | 显示全部楼层
不错,thanks
发表于 2012-3-17 01:14:15 | 显示全部楼层
正好在学习,下载了看看!
发表于 2013-10-11 14:27:51 | 显示全部楼层
thanks for sharing
发表于 2015-11-3 10:58:12 | 显示全部楼层
Simulating Verilog RTL using Synopsys VCS
发表于 2015-11-27 03:39:17 | 显示全部楼层
thnx!
发表于 2018-8-20 11:44:33 | 显示全部楼层
thanks`
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