unsigned to signed assignment occurs

X6J6P6 · 发表于 2010-7-9 15:38:29

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大家好，我在用dc进行逻辑综合时，出现“unsigned to signed assignment occurs”警告，这种警告严重吗？是不是必须修改rtl代码啊？

zh123456789 · 发表于 2010-7-11 16:00:26

感觉挺严重的，和绕口令差不多

kuangjianghua · 发表于 2010-7-15 14:50:26

有时候rtl用此类写法的仿真效率比较高，算法设计也比较简单，但综合工具会报出warning代表工具对此的处理不够有保证，最好是能够将网表再次进行仿真，确保无误即可

jolin821 · 发表于 2010-7-17 20:52:46

之前也有遇到过，如果有这样的WARINING，在compile的时候可能会出现问题

hitten · 发表于 2010-7-18 21:48:27

这种问题修改rtl

wuzumakinaluduo · 发表于 2016-3-9 10:30:36

我在dc综合时也出现了同样的警告，请问一下这个问题该怎样解决，修改rtl代码时，应该从哪个方面下手？

mnluan · 发表于 2016-3-11 15:26:13

回复 6# wuzumakinaluduo

这个warn就是提醒，有符号数的变量被赋值给了无符号数的变量，或者是倒过来。检查一下代码，看是不是设计上所要的，还是说在写代码的时候遗漏了signed或是unsigned的定义。

菜鸟级射手 · 发表于 2022-6-21 20:25:36

大佬，怎么解决的

Ayala058 · 发表于 2023-3-6 16:37:09

感谢解答~

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