时钟分频

aaaal · 发表于 2006-9-9 10:08:07

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我现在用的是ep1c12，60M晶振，可不可以通过分频获得50M的时钟?

yinchyang · 发表于 2006-9-9 10:47:41

肯定可以，其实就是计算6个上升沿只输出5个上升沿，
不过这样的时候不等频，要注意

power-twq · 发表于 2006-9-9 14:55:38

比较困难，建议直接使用50MHZ 晶振

yinchyang · 发表于 2006-9-9 15:00:37

如果允许上升沿之间不等间隔，是可以实现的，
如果要求上升沿等间隔，那肯定不行，

aaaal · 发表于 2006-9-10 16:59:07

输出时钟给D/A，应该不要求等间隔吧

ghb99041118 · 发表于 2006-9-10 19:25:30

奇怪，很不实际的应用哦，为沈默要这没做那

aaaal · 发表于 2006-9-11 13:14:29

是一个在DSP+FPGA系统中是使用，fpga用来管理8路A/D和8路D/A。不知道这样做可不可以，又没有跟好的解决方法

cat-floating · 发表于 2006-9-12 10:20:04

不等频没问题，只要占空比和时序满足就行了。

aprilwgp · 发表于 2006-9-12 10:47:23

关注！！！

bandao · 发表于 2006-9-12 11:36:15

对DA AD 不是很清楚啊

60M得到50M