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[原创] 一个reset的时序分析

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发表于 2010-5-6 10:56:57 | 显示全部楼层 |阅读模式

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reaet时序分析.jpg 大家看看啊
发表于 2010-5-6 11:18:09 | 显示全部楼层
这是什么cell啊这么大的tran。。。。。。。。 1# ckzuan
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 楼主| 发表于 2010-5-6 11:41:06 | 显示全部楼层
是的啊 我个人觉得是异步复位 是不是应该设置为false_path啊 还有面有个library recovery time 一般报告里也没有的
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发表于 2010-5-6 22:24:26 | 显示全部楼层
对reset这种同步逻辑中的异步信号,STA也是可以进行时序分析的,分析的方式和同步逻辑setup与hold相类似,但是叫recovery time和removal time,具体的概念可以查看PT fundmental user guide。
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 楼主| 发表于 2010-5-7 14:45:46 | 显示全部楼层
4# haier-ic
谢谢大侠! 那一般这种violation是不是在综合时就不管了啊?
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发表于 2010-5-8 10:42:59 | 显示全部楼层
set_dont_touch一下!
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发表于 2010-5-9 22:48:24 | 显示全部楼层
Please check if you have set correct max_fanout ,  max_transition during synthesis step. here you could you you have a huge load
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发表于 2010-5-11 16:42:17 | 显示全部楼层
狂顶,只能先学习了
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 楼主| 发表于 2010-5-11 22:07:49 | 显示全部楼层
7# lemonwait 您说的DRC一些合适的值是不是来自单元库啊 需要get_attribute一下 然后再根据这个标准来设置一些合适的值 即不能太紧也不能太松啊?
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