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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › Verilog HDL程序设计实例详解(光盘)
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楼主: jiemizhe

[资料] Verilog HDL程序设计实例详解(光盘)

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QQben
发表于 2016-1-19 11:10:12 | 显示全部楼层
谢谢分享
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QQben
发表于 2016-1-19 11:17:38 | 显示全部楼层
谢谢分享
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yinglin
发表于 2016-1-19 19:56:44 | 显示全部楼层
it is good! Thanks for the sharing!
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nianjiewang
发表于 2016-1-23 21:52:26 | 显示全部楼层
感謝分享~~
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dongdongic
发表于 2016-2-6 11:24:50 | 显示全部楼层
纯光盘啊～
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Ryggeor
发表于 2016-2-6 13:06:38 | 显示全部楼层
thnx!
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落雪听禅
发表于 2016-2-15 07:30:46 | 显示全部楼层
光盘内容
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转-轮-王
发表于 2016-2-25 22:36:29 | 显示全部楼层
正在学，下来看看
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梦凝霜
发表于 2016-3-1 13:34:38 | 显示全部楼层
是光盘内容，请问楼主有这本书的PDF?
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chuhanfengyun
发表于 2016-3-8 19:11:22 | 显示全部楼层
感谢楼主分享！努力学习中！
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