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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › Verilog HDL程序设计实例详解(光盘)
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楼主: jiemizhe

[资料] Verilog HDL程序设计实例详解(光盘)

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lemor
发表于 2017-5-9 12:14:01 | 显示全部楼层
感谢楼主
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szucjh
发表于 2017-6-30 19:26:59 | 显示全部楼层
xiexeila
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lynn_yp
发表于 2017-7-28 21:02:38 | 显示全部楼层
谢谢分享！
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QQben
发表于 2017-9-21 09:28:39 | 显示全部楼层
谢谢分享幸福
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xidianstudent
发表于 2017-9-21 20:08:10 | 显示全部楼层
多谢分享
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z164458342
发表于 2017-12-11 20:10:43 | 显示全部楼层
厉害厉害
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shining-z
发表于 2018-1-17 11:41:17 | 显示全部楼层
是光盘内容，有的不知道是啥
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dasubuaa
发表于 2018-1-19 15:08:15 | 显示全部楼层
都是源代码，很好！
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小龙眼
发表于 2018-5-10 13:40:10 | 显示全部楼层
谢谢分享
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uiwjyb
发表于 2018-7-7 16:44:23 | 显示全部楼层
回复 1# jiemizhe


   光盘内容？
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