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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › Verilog HDL程序设计实例详解(光盘)
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楼主: jiemizhe

[资料] Verilog HDL程序设计实例详解(光盘)

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qwfy007
发表于 2015-2-20 12:00:32 | 显示全部楼层
已完成，谢谢
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zjwei2003
发表于 2015-2-20 14:54:28 | 显示全部楼层
这个资料不错
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zjwei2003
发表于 2015-2-23 12:52:33 | 显示全部楼层
谢谢分享
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piterconchas
发表于 2015-2-23 22:28:16 | 显示全部楼层
Excellent material!
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zw978
发表于 2015-3-22 21:23:05 | 显示全部楼层
真的是光盘内容啊？
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zw978
发表于 2015-3-22 21:24:17 | 显示全部楼层
用到 谢谢楼主分享！！
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duray
发表于 2015-4-29 23:40:13 | 显示全部楼层
文件被破坏！！！
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siryang13
发表于 2015-4-30 23:19:47 | 显示全部楼层
haodongxi
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lzzeng
发表于 2015-5-9 08:20:57 | 显示全部楼层
谢谢分享！
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yua123
发表于 2015-5-23 10:22:25 | 显示全部楼层
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