IEEE论文的一个电路图，不难，但愣是没看明白，谁解释一下？

DukeLeon

注意一下LVA后面的八个cascaded amplifier，就是CMOS Inverter吧，中间加个反馈电阻可以提高增益和减少功耗。
这个就是整个的设计了，没有任何额外的偏置电路啥的。
想问下，那八个级联的inverter怎么可能工作在饱和区啊？LVA后面加了一个电容，这样进入第一级inverter的直流电压就是0啊，第一级就不放大，后面怎么工作啊？
这个是0.18um工艺的，我用0.6um工艺仿了一下那个级联放大器，根本就不行..哪位高手解释一下？

iamxo

inv 那个电阻就可以决定输入直流电压啊，和该inv的输出直流电压一样。所以，应该能工作。

confiope

只要负反馈的增益足够大，就能保证管子处于饱和区，
LZ调调电路参数吧

confiope

   

原帖由 DukeLeon 于 2009-6-23 08:32 发表

                               
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178687
注意一下LVA后面的八个cascaded amplifier，就是CMOS Inverter吧，中间加个反馈电阻可以提高增益和减少功耗。
这个就是整个的设计了，没有任何额外的偏置电路啥的。
想问下，那八个级联的inverter怎么可能 ...

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理论上因为有负反馈，所以第一级的输入直流电压不是零
实际上，如果输入电压为0。那么第一级输出端电压接近VDD，通过反馈电阻，输出端岂不为VDD了？
所以它会稳定在一个合适的地方，当然参数要设置好。

fuyibin

   

原帖由 DukeLeon 于 2009-6-23 08:32 发表

                               
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注意一下LVA后面的八个cascaded amplifier，就是CMOS Inverter吧，中间加个反馈电阻可以提高增益和减少功耗。
这个就是整个的设计了，没有任何额外的偏置电路啥的。
想问下，那八个级联的inverter怎么可能 ...

常用的结构啊，静态的时候，inverter输入输出间接一个电阻确定dc operating point
就相当于两个diode connect的nmos/pmos连接在vdd/vss间

122013137

   

原帖由 DukeLeon 于 2009-6-23 08:32 发表

                               
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注意一下LVA后面的八个cascaded amplifier，就是CMOS Inverter吧，中间加个反馈电阻可以提高增益和减少功耗。
这个就是整个的设计了，没有任何额外的偏置电路啥的。
想问下，那八个级联的inverter怎么可能 ...

中间加个反馈电阻不是提高增益，是提高稳定性，并且兼顾DC AC的稳定性， 你可以看为是自偏置静态工作点

steady

同意六楼的观点，我分析了一下小信号模型，发现加上这个栅漏电阻会导致反相器的增益变小，但是稳定性的问题没看太明白，六楼的麻烦给解释一下

DukeLeon

谢谢各位，我仿过了，应该说是gain bandwidth product 变大了

hezudao

It is a traditional shunt feedback LNA

[ 本帖最后由 hezudao 于 2009-6-23 23:10 编辑 ]

strennor

   

原帖由 122013137 于 2009-6-23 11:52 发表

                               
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中间加个反馈电阻不是提高增益，是提高稳定性，并且兼顾DC AC的稳定性， 你可以看为是自偏置静态工作点

请教一下：这个稳定性怎么估算？
另外，这种反相器并联电阻的放大器会不会对Ground Bounce非常敏感？当后面的Buffer翻转引起片子上GND变化，而带来输入端搁置电容前后变化不同，会不会误翻转？