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楼主: littleannie

关于PLL相位噪声的仿真

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发表于 2009-3-24 14:56:38 | 显示全部楼层
发表于 2009-3-24 20:44:47 | 显示全部楼层
Not frequency but phase. All the kinds of noise in the loop can be translated to the phase deviation compared with the ideal reference clk. The phase error over 2pi then squared is just the phase noise in dBc. All the simulators use this fudamental to calculate pll phase noise.
发表于 2009-3-25 15:41:42 | 显示全部楼层
没仿过
发表于 2009-3-25 17:59:46 | 显示全部楼层

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VerilogA系统建模,可以~~

[ 本帖最后由 superrabbit 于 2009-3-25 18:02 编辑 ]
发表于 2009-3-30 15:57:53 | 显示全部楼层
模块仿真出来,然后建模自己算, 传递函数,功率叠加!
发表于 2009-4-1 23:02:34 | 显示全部楼层

好东西

能学到很多东西啊!!
发表于 2009-4-7 18:06:27 | 显示全部楼层
看看呢,刚好要找论文
发表于 2009-4-9 13:06:02 | 显示全部楼层
十分感谢
发表于 2009-4-10 16:54:58 | 显示全部楼层
关键市系统TF建模吧
发表于 2009-5-28 16:23:33 | 显示全部楼层
999999999
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