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数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 3 |主题: 30091|排名: 11 

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[解决] 基于FPGA高精度TDC设计 attachment digest  ...23456..7 coyoo 2013-2-18 6440028 霍格沃兹 2022-5-9 16:40
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[解决] linux 下安装modelsim license error问题 attach_img  ...2 A_B_C_D_1 2012-11-22 187018 孙田雨 2016-5-31 15:33
[解决] 突然发现assign用的好少  ...234 ruiruio4 2009-12-15 359844 bornforhappy 2010-12-13 16:59
[解决] 布图布线前 pt生成的sdf文件无法正确sign_off的问题 attach_img  ...2 flyingsheep 2013-4-1 179585 ningyuan198 2016-12-16 09:59
[解决] 解决VCS 2016.03仿真Stack trace follows attachment  ...2 Jerry张 2018-1-5 1612577 quifei 2022-7-4 18:09
[解决] linux菜鸟进来看。。历时n天终于装好了dc 200809。。高手莫笑 agree  ...2 pzchu 2011-4-26 104258 huatiantian 2011-5-28 18:16
[解决] 循环路径的时序约束 attach_img  ...2 flyingsheep 2013-3-27 145785 znn04006518 2013-12-24 17:02
[解决] 同步多时钟综合问题  ...2 eda—wdy 2015-9-30 154852 Andy126 2018-12-24 14:01
[解决] 求IUS92通过verdi2009 如何导出fsdb文件???????——(问题以解决) 清水一杯 2012-11-7 911658 wlmwxm 2017-9-27 10:35
[解决] Design Compiler 中RAM模型最终在工艺库中如何实现 haijiaoyouzi 2011-12-19 94541 hbyu 2013-5-1 17:57
[解决] 请问Verilog中的这个问题怎么处理?只能仿真不能综合. 冈崎君 2018-12-24 94048 iceinsky 2019-1-3 13:42
[解决] 关于synopsys的scl 11.4在ubuntu10.04中的安装问题  ...2 daileyu 2013-6-3 146454 Traviss 2020-3-6 13:14
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[解决] formality形式验证的必要性 flyingsheep 2013-3-28 98130 Gary.wang 2013-4-7 12:25
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[解决] FPGA配置时间请教 attach_img qd0090 2014-1-7 83379 icey09 2015-3-16 14:31
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