在线咨询 切换到宽版
eetop公众号 创芯大讲堂 创芯人才网

 找回密码
 注册

手机号码,快捷登录

手机号码,快捷登录

搜全文
收藏本版 (168) |订阅

后端讨论区 今日: 2 |主题: 22645|排名: 14 

[求助] PTPX的动态功耗分析生成的波形图为什么会是锯齿状 新人帖 7点起床读书 2023-4-21 62808 Tsengsink 2023-12-19 22:00
[求助] 增加门控时钟开关功耗大幅增加 DMBDYQ 2023-12-19 11545 黄焖鸡 2023-12-19 17:09
[求助] 关于report_cell_instance_timing中的疑问 thrallzy 2023-12-18 21470 thrallzy 2023-12-19 16:31
[求助] WNS and TNS  ...2 yangics 2011-3-25 1821608 wlf204 2023-12-19 14:39
antenna lef的问题请教 daisyniu 2006-11-13 78537 lndxeb 2023-12-19 14:35
[求助] Abstract提取lef求助  ...23456 gyl1125 2011-4-25 5331344 lndxeb 2023-12-19 14:30
[求助] LVS IC后端小楠 2023-12-18 21660 卷芯菜 2023-12-19 14:24
[求助] 如何比较两个版图是否一致?  ...2 Veriart 2015-1-10 116747 摩卡咖啡 2023-12-19 11:28
[求助] ICC 打开以前的Design出现问题  ...2 dddzr 2013-12-30 128332 liyy123456 2023-12-18 22:06
[求助] LVS rule file关于LVS REDUCE语法 求助! 新人帖 SUZIYUAN 2023-12-18 01610 SUZIYUAN 2023-12-18 21:19
[求助] 关于report_net的报告问题 thrallzy 2023-12-18 01588 thrallzy 2023-12-18 20:07
[求助] voltus进行static rail analysis报错 MWH_marven 2023-12-18 61809 MWH_marven 2023-12-18 17:33
[求助] tetramax atpg中,在读入verilog lib model时,报错N1 xiaoqi1002 2023-12-13 21525 xiaoqi1002 2023-12-18 16:04
[求助] 关于DFT FLow的问题 又来长脑了 2023-12-18 11548 zhiwenhao 2023-12-18 14:13
[求助] PT反标在网表里找不到net 周一一 2023-12-5 31535 周一一 2023-12-18 11:48
[原创] SPI综合约束添加 someone_0506 2023-12-17 21854 someone_0506 2023-12-18 10:28
[求助] 关于dc综合出现问题 xiuxiu_vvv 2023-12-15 41941 xiuxiu_vvv 2023-12-16 16:36
[求助] Genus物理综合求助 xiaopet 2023-12-14 11707 kk2009 2023-12-16 11:39
[求助] PTPX计算peak power的数值和transition什么关系 新人帖 ganjunjie 2023-12-13 21458 liemk 2023-12-15 19:20
[求助] addfiller之后出现drc报错,该怎么处理?直接删除这个filler可以吗? fanyf 2023-11-28 42374 masj2022 2023-12-15 18:09
[原创] 插filler cell报出的drc的问题 Tfp 2023-3-1 52299 uskan 2023-12-15 17:52
[原创] 請問 Innovus 相關問題 a2s2 2023-11-29 21976 卷芯菜 2023-12-15 14:41
[求助] 问题已解决 删帖 fangwang85 2023-12-15 1861 卷芯菜 2023-12-15 14:31
[求助] innovus addFiiler加不满 - [已解决]  ...2 759224749 2023-11-29 144327 wisywyx 2023-12-15 14:12
[求助] fusion compiler migration assistant 南波湾001 2023-12-11 41900 yinxr 2023-12-15 13:41
[求助] 新人做数字后端,vdd、vss分别为0v、1.8v,当在cadence中仿真出现1.4v,请问正常吗? modoalos 2023-12-12 21885 modoalos 2023-12-15 10:51
[求助] timing mode fangwang85 2023-12-1 81698 zhh124 2023-12-15 10:31
[求助] set_max_transition与set_clock_transition有什么关系 新人帖 someone_0506 2023-12-13 53320 king-wa 2023-12-15 10:06
[求助] 大佬们,新人刚入,想问一些关于cadance RC 的问题 - [悬赏 200 信元资产] zgh99 2023-12-15 01894 zgh99 2023-12-15 09:39
[求助] Ansys Products 2023包含了哪些软件,redhawk-SC包含了吗 LuckyEDAZ 2023-9-10 52521 myedacn 2023-12-15 06:25
[讨论] dc2016 和dc2012 面积综合出来不同 chenyueboy 2017-2-20 64751 leixaut 2023-12-14 23:19
[求助] DC综合后出现一个奇怪的fanout过大的问题,求各位大神给点意见  ...2 archertake 2014-6-26 1011184 xiaoyue12 2023-12-14 15:43
[求助] RTL vs DC后的netlist 做fm时svf是不是必须的【已解决】  ...2 jiazhang 2015-5-6 105388 xiaoyue12 2023-12-14 15:39
[求助] PR 新人帖 啵啵33 2023-12-11 31375 xiaoyue12 2023-12-14 15:38
[求助] 如何在pcell中 打孔 杨原仪 2023-11-15 51698 杨原仪 2023-12-14 13:34
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /2 下一条

手机版| 小黑屋| 关于我们| 联系我们| 用户协议&隐私声明| 版权投诉通道| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 ) |网站地图

GMT+8, 2025-12-20 10:35 , Processed in 0.024170 second(s), 5 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块