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楼主: xzffff

如何用VHDL或verilog HDL实现时钟的2倍频?

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发表于 2008-9-24 19:01:36 | 显示全部楼层
这个,这个,

还是用PLL或DLL来实现吧,用逻辑实现的时钟没法保证skew和jitter。
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发表于 2008-9-24 19:03:51 | 显示全部楼层
灌纯水,赚分下载!!
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发表于 2009-3-4 10:31:44 | 显示全部楼层
kankan
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发表于 2009-3-7 22:05:48 | 显示全部楼层
期待答案...
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发表于 2009-3-9 11:10:52 | 显示全部楼层




我们做一个项目的时候就是采用这个办法的。。
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发表于 2009-4-27 17:11:22 | 显示全部楼层
想问一下,为什么用纯语言实现的倍频源代码不能综合?
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发表于 2009-6-2 15:47:48 | 显示全部楼层
看看是否能用
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发表于 2009-6-16 19:53:19 | 显示全部楼层

倍频

可以实现
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发表于 2009-8-6 19:25:09 | 显示全部楼层
xilinx中自带的dll,要怎么实现?不需要用代码调用吗?直接内部会倍频好的???要调用怎么调用的啊
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发表于 2009-8-22 22:38:41 | 显示全部楼层
HDL還可以這樣用喔
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