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[统计] 你是用VHDL还是用Verilog HDL?

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发表于 2011-9-8 15:27:33 | 显示全部楼层 |阅读模式
看到发问的朋友很多都是verilog,所以做个调查看看大家主要用那种FPGA编程语言?
单选投票, 共有 3349 人参与投票
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发表于 2011-9-9 08:57:42 | 显示全部楼层
还是喜欢用VHDL
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发表于 2011-9-9 21:20:40 | 显示全部楼层
我觉得VERILOG好上手
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发表于 2011-9-13 16:13:54 | 显示全部楼层
用的verilog
不过想学学VHDL
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发表于 2011-9-14 15:46:14 | 显示全部楼层
都会用,但是现在用的vhdl。verilog好上手些,学了verilog学vhdl很快,认真看看,实现基本功能一周就够了
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发表于 2011-9-17 11:32:46 | 显示全部楼层
当然是用verilog,个人感觉verilog是主流,VHDL十年之后估计就不行了
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发表于 2011-9-18 09:59:34 | 显示全部楼层
当然是用verilog,个人感觉verilog是主流
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发表于 2011-9-21 20:32:28 | 显示全部楼层
我也觉得VERILOG好上手
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发表于 2011-9-23 19:17:09 | 显示全部楼层
VERILOG 看着容易点~~
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发表于 2011-9-24 01:57:29 | 显示全部楼层
能出设计就好。
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