PLL当中的ring oscillator phase noise

Jeecoun · 发表于 2012-4-13 09:43:57

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最近在做ADPLL，在simulation里，我的ring oscillator做出来后发现phase noise 很大，转换成jitter在4GHz足足有5ps的jitter。我想问的是现在我有的仅仅是ring oscillator，那上面通过对phase noise积分所得到的5ps jitter是不是最终的cycle-to-cycle jitter?还是这个jitter会被PLL过滤些，比5ps少？

我知道peak-to-peak jitter肯定会被PLL过滤一部分，但不知道cycle-to-cycle怎么办？谢谢。

fogworld · 发表于 2012-4-19 21:06:41

高手出来解答

shadowsun · 发表于 2012-6-14 17:49:27

回复 1# Jeecoun

phase noise 直接积分得到的jitter并不是cy-cy jitter, 而是absolute jitter
通过phase noise 计算cy-to-cy jitter时要将phase noise 进行sin调制，简单来说就是高通滤波，ring oscillator的大部分相位噪声都会被滤除。
但这样得到的cy-to-cyjitter不一定会小，这取决于你积分的下限。

lgy747 · 发表于 2012-6-14 23:13:57

本帖最后由 lgy747 于 2012-6-14 23:15 编辑

phase noise 直接积分得到的jitter并不是cycle-to-cycle jitter, 也不是absolute jitter，而是period jitter。
将period jitter对离散时间求导后就是cycle-to-cycle jitter，而不是将phase noise 进行什么sin调制，高通滤波。
因为cycle-to-cycle jitter反映了jitter的变化速率，所以它的大小对应于phase noise的高频部分，即受积分频率的上限影响，而不是下限。同时它还取决于你的vco自由震荡的频谱与pll环路增益的乘积的倒数。因为pll环路增益呈低通特性，对phase noise的高频部分基本无滤波作用，所以cycle-to-cycle jitter不会变小很多

siyo · 发表于 2012-6-16 19:45:52

正常的，可以滤掉很多。我现在这个只计算VCO有11.5ps，还是LC的。带入环路计算它的贡献只有0.5p，跟你滤波器的带宽有关，带内的很多都被滤掉了

shadowsun · 发表于 2012-6-20 17:47:13

回复 4# lgy747

你去补充一下理论知识就知道我说的什么意思了

薛定谔的太极拳 · 发表于 2014-12-1 15:14:03

回复 7# shadowsun

大神，跪求详细说明一下，

Error · 发表于 2014-12-1 20:47:56

VCO主要是LOOP的高频部分

xd_HR · 发表于 2015-2-9 21:59:06

Ring oscillator 受电源或地的干扰有考虑过吗？是怎么避免影响的

greatdilly · 发表于 2015-2-9 22:27:57

积分出来的是rms jitter
PLL会将振荡器低频噪声滤掉，滤多少看环路带宽多少，应该完全可以比振荡器小

[求助] PLL当中的ring oscillator phase noise

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