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[资料] SVTB,systemverilog for testbench入门教程

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发表于 2012-2-21 14:19:17 | 显示全部楼层 |阅读模式

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SVTB, systemverilog for testbench入门教程
包含基本的语法,详细,逐步深入,很好的资料~~~~~~ SVTB.zip (450.01 KB, 下载次数: 3370 )
发表于 2012-2-24 15:25:29 | 显示全部楼层
New ??????????
发表于 2012-3-5 23:36:42 | 显示全部楼层
我只能说eetop真是个好地方,相见恨晚,需要systemverilog中。。
发表于 2012-3-11 10:56:41 | 显示全部楼层
thanks all
发表于 2012-3-12 11:28:47 | 显示全部楼层
Thanks a lot.
发表于 2012-3-18 14:17:31 | 显示全部楼层
thank you for your sharing!!!!
发表于 2012-3-18 22:10:16 | 显示全部楼层
sv is too powerfull~
发表于 2012-3-19 00:05:57 | 显示全部楼层
貌似见过,是新的吗
发表于 2012-3-19 13:51:40 | 显示全部楼层
sv is too powerfull~
发表于 2012-3-19 15:09:29 | 显示全部楼层
下下来看看,学习一下
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