数字逻辑

sean_4413 · 发表于 2011-4-2 19:22:36

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各位大虾

如图所示的上下两波形：波形A 产生高电平时，波形B 产生低电平，并且波形A 高电平的脉宽要比波形B此时低电平的脉宽大。

现在当出现这样的上下波形时，输出为0；

当波形A 和波形B 都为高电平时，输出为1，请问这样的数字逻辑如何设计啊！！

njithjw · 发表于 2011-4-2 22:30:04

没有看太明白，是不是A和B直接相与就可以了。

wml409 · 发表于 2011-4-3 00:09:31

呵呵，楼上貌似正解。。。

sean_4413 · 发表于 2011-4-3 14:09:53

相与怎么可以呢？
相与时上下两个波形都有高的情况出现啊

JD.WARLOCK · 发表于 2011-4-3 17:14:28

上下都为高，相与的结果不就是1，这不就是你想要的？

sean_4413 · 发表于 2011-4-3 20:33:25

本帖最后由 sean_4413 于 2011-4-3 20:34 编辑

上下都为高，相与的结果不就是1，这不就是你想要的？
JD.WARLOCK 发表于 2011-4-3 17:14

登录/注册后可看大图

不是的，只要有脉冲形式，即便出现同时为1的情况,那就为0，并且脉冲波形是图形所示的形式.
而只有都一直同时为高时，才会输出1的

sean_4413 · 发表于 2011-4-4 09:28:02

再求帮忙啊

hahalucky · 发表于 2011-4-4 13:31:30

描述的还不够清楚，我看了几遍没有看懂

sean_4413 · 发表于 2011-4-4 20:03:49

回复 8# hahalucky

是这样的，你有没有发现下面的波形好像是上面波形经过delay产生的啊，并且上面波形的占空比要>0.5的，即高电平的宽度要大于低电平的宽度的。

就是说产生这样的两种波形时，将这两种波形经过“与非门”“或非门”或其他等等的数字逻辑单元时，会产生0电平呢？

上面是一种情况，并且这两种波形也有同时为一直高电平的情况，当出现这种情况时，经过同样的“与非门”“或非门”或其他等等的数字逻辑单元时，会产生1电平呢？

这个“与非门”“或非门”或其他等等的数字逻辑单元就是现在要设计的结构

hahalucky · 发表于 2011-4-4 20:34:36

看你图中有同时为1的情况，只不过时间比较短，输出还是0，对吧？那么同时为都为1且持续时间很长时，又要输出为1。显然不是简单的组合逻辑可以实现的，估计只能用积分器、电荷泵之类的模型了。不知道我的理解对不对？

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