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[资料] RS编码器译码器设计（Verilog）

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jqxhit
发表于 2010-3-20 13:24:41 | 显示全部楼层 |阅读模式

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RS.doc (154.5 KB, 下载次数: 483 )
编码器, 设计, 译码器

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dyf312
发表于 2010-3-25 19:12:45 | 显示全部楼层
学习下
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hainabc
发表于 2010-3-31 14:55:40 | 显示全部楼层
let me see thanks
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wushihai
发表于 2010-4-17 11:31:40 | 显示全部楼层
不错，很不错。
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puyuwei
发表于 2010-4-17 17:13:11 | 显示全部楼层
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taoy1986
发表于 2010-4-29 10:16:01 | 显示全部楼层
1# jqxhit

谢谢
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b1h2x3
发表于 2010-4-29 10:56:34 | 显示全部楼层
谢谢，正需要这个
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beiguoqishi
发表于 2010-5-1 23:50:43 | 显示全部楼层
很急需不知有没有用
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lovemei
发表于 2010-5-1 23:53:10 | 显示全部楼层
直接从书上截来的啊，不知道楼主有没有仿过行不行啊
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coolsky
发表于 2010-5-3 00:46:23 | 显示全部楼层
谢谢分享
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