lvs incorrect nets 大神帮看一下!!!!!

yuenlee

目前遇到 incorrect nets，Layout Extra Pins 50 54 78这三个分别是VDD GND VDD18，等于一个IP有各两个VDD GND VDD18 pins
incorrect nets hightlight的地方都是在这三个Pins上，想请问这个问题要怎么做解决


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                  COMPONENT TYPES WITH NON-IDENTICAL SIGNAL PINS
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      (Cells with the same ( or corresponding ) name that have different signal
       pin names are listed below.  Pins that do not appear in all corresponding
       cells in both source and layout are ignored by the comparison algorithm.)

Layout Component Type:  IP_test (79 pins)
Layout Extra Pins:      50 54 78

Source Component Type: IP_test  (76 pins)
No Extra Pins.



                   CELL COMPARISON RESULTS ( TOP LEVEL )



                  #   #         #####################  
                   # #          #                   #  
                    #           #     INCORRECT     #  
                   # #          #                   #  
                  #   #         #####################  


  Error:    Different numbers of nets (see below).
  Error:    Connectivity errors.
  Error:    Property errors.
  Warning:  Ambiguity points were found and resolved arbitrarily.

LAYOUT CELL NAME:         chip_mtp_top
SOURCE CELL NAME:         chip_mtp_top

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INITIAL NUMBERS OF OBJECTS
--------------------------

                Layout    Source         Component Type
                ------    ------         --------------
Ports:             73        98    *

Nets:           33184     33541    *

Instances:       2170      2170         M (4 pins)
                 34720     34720         MN (4 pins)
                 34958     34958         MP (4 pins)
                   211       211         R (3 pins)
                   501       501         D (2 pins)
                     1         1         IP_test (76 pins)
                ------    ------
Total Inst:     72561     72561


NUMBERS OF OBJECTS AFTER TRANSFORMATION
---------------------------------------

                Layout    Source         Component Type
                ------    ------         --------------
Ports:             73        73

Nets:           33039     33036    *

Instances:        345       345         M (4 pins)
                 32708     32708         MN (4 pins)
                 32527     32527         MP (4 pins)
                   211       211         R (3 pins)
                   244       244         D (2 pins)
                     1         1         IP_test (76 pins)
                ------    ------
Total Inst:     66036     66036


       * = Number of objects in layout different from number in source.



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                                 INCORRECT OBJECTS
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LEGEND:
-------

  ne  = Naming Error (same layout name found in source
        circuit, but object was matched otherwise).


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                                   INCORRECT NETS

DISC#  LAYOUT NAME                                               SOURCE NAME
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  1    Net GND0                                                  GND0
           X2/80                                                
       --- 22 Connections On This Net ---                        --- 22 Connections On This Net ---


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  2    Net VDD18                                                 VDD18
           X2/78                                                
       --- 4 Connections On This Net ---                         --- 4 Connections On This Net ---

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  3    Net VDD0                                                  VDD0
           X2/79                                                
       --- 8 Connections On This Net ---                         --- 8 Connections On This Net ---

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yuenlee

后续发现连接处没有打via，所以才会出现问题