cadence stb仿真相位从0开始

超级人机 · 发表于 2024-12-16 13:46:24

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cadenec中stb仿真相位图正常情况下应该是从180度开始变化，用浮栅控制classAB结构，把管子bulk接源极仿真正常，把bulk接vdd或gnd时，stb仿真只有温度很低的情况下正常，温度稍微大一点相位就会从0开始变化，求助各位大佬

肥鸡跳墙 · 发表于 2024-12-16 14:11:49

有点诡异，毕竟是前仿真

超级人机 · 发表于 2024-12-16 14:22:43

肥鸡跳墙发表于 2024-12-16 14:11
有点诡异，毕竟是前仿真

把B和S接一起就不会发生这种情况，这是由于vds过大然后bulk漏电导致极点改变造成的嘛

ZixunWang · 发表于 2024-12-16 14:23:37

先检查一下负反馈正确吗？之前有个帖子，大家反馈是软件仿真环境导致的，没啥大问题。

超级人机 · 发表于 2024-12-16 14:29:49

ZixunWang 发表于 2024-12-16 14:23
先检查一下负反馈正确吗？之前有个帖子，大家反馈是软件仿真环境导致的，没啥大问题。 ...

接的是单位增益负反馈

ZixunWang · 发表于 2024-12-16 15:19:01

超级人机发表于 2024-12-16 14:29
接的是单位增益负反馈

你去站里面搜一下，一搜就能搜到的，里面有讨论，胡诣哲老师说是仿真软件的问题

超级人机 · 发表于 2024-12-16 15:36:15

ZixunWang 发表于 2024-12-16 15:19
你去站里面搜一下，一搜就能搜到的，里面有讨论，胡诣哲老师说是仿真软件的问题 ...

好的感谢你

N##A##N · 发表于 2024-12-16 16:34:22

浮栅结构的老问题啦，看看这个帖子：http://bbs.eetop.cn/thread-290155-1-1.html 27#的回答

超级人机 · 发表于 2024-12-16 16:50:45

N##A##N 发表于 2024-12-16 16:34
浮栅结构的老问题啦，看看这个帖子：http://bbs.eetop.cn/thread-290155-1-1.html 27#的回答 ...

大概明白了感谢分享

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