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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › SystemVerilog 经典文档——学习SV有效途径

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楼主: 0xffff

SystemVerilog 经典文档——学习SV有效途径

发表于 2010-4-12 19:46:24 | 显示全部楼层

多谢LZ

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发表于 2010-4-19 14:21:08 | 显示全部楼层

dddddddddddddd

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发表于 2010-4-20 10:28:22 | 显示全部楼层

谢谢谢谢

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发表于 2010-4-20 10:30:17 | 显示全部楼层

Thanks very much !

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发表于 2010-4-27 23:58:36 | 显示全部楼层

thanks...

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发表于 2010-5-5 11:39:04 | 显示全部楼层

Thanks

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发表于 2010-5-5 17:05:05 | 显示全部楼层

xiexiellz

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发表于 2010-5-5 23:44:01 | 显示全部楼层

支持一下，多谢楼主~~~~~~！！

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发表于 2010-5-6 21:58:48 | 显示全部楼层

多谢楼主！

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发表于 2010-6-24 11:02:45 | 显示全部楼层

希望有所收获，谢

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