PLL 输出频率谐波过大

cllideboy · 发表于 2024-10-11 10:33:26

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参考频率用的是有源晶振10M，PLL输出频率125M，看125M的输出频谱时，10M的谐波很大呀，这是什么原因呀？求路过的大佬帮忙看下

tsilung · 发表于 2024-10-11 11:10:37

reference spur

wandola · 发表于 2024-10-11 15:25:50

pll输出125M？ref =10M？带宽是多少？1MHz？

你这个带宽可以再小一点，可以把ref spur滤掉很多
估计是lpf漏电太大了把

cllideboy · 发表于 2024-10-11 17:28:38

wandola 发表于 2024-10-11 15:25
pll输出125M？ref =10M？带宽是多少？1MHz？

你这个带宽可以再小一点，可以把ref spur滤掉很多

带宽是300k左右，LPF漏电大是什么意思呀？LPF电容是用mim和mos管电容组合的，电容不准

cllideboy · 发表于 2024-10-11 19:53:10

PLL前面有个2分频的预分频

cllideboy · 发表于 2024-10-11 19:54:19

wandola 发表于 2024-10-11 15:25
pll输出125M？ref =10M？带宽是多少？1MHz？

你这个带宽可以再小一点，可以把ref spur滤掉很多

PLL前面有个2分频的预分频，实际参考频率是5M

xuwenwei · 发表于 2024-10-12 09:34:44

你用的是5M的ref 为什么10M的ref spur比5M的ref大呢

lwzunique · 发表于 2024-10-12 09:52:46

这是一个有趣且复杂的问题，reference spur的各种混频，衬底耦合，电源耦合，esd环耦合，片外耦合都是可能的原因。
干扰必然存在，只是或大或小的问题，只要不影响系统工作，就那么滴吧。
至于排查方法，这又比较复杂了，电源可以用更干净的不？滤波器可以配置不？reference可以外加不？梳理梳理版图有没有和时钟耦合比较严重的，电源有没有被是时钟耦合，隔离环加的有没有异常的地方，屏蔽线有没有做到很好的屏蔽，电源的滤波有没有做好。

wandola · 发表于 2024-10-12 14:00:54

xuwenwei 发表于 2024-10-12 09:34
你用的是5M的ref 为什么10M的ref spur比5M的ref大呢

正解。这个就是pre-divider电源couple过来的。

cllideboy · 发表于 2024-10-14 11:01:06

lwzunique 发表于 2024-10-12 09:52
这是一个有趣且复杂的问题，reference spur的各种混频，衬底耦合，电源耦合，esd环耦合，片外耦合都是可能 ...

带宽可以配置，但是效果几乎没有，目前自己怀疑是哪里耦合过来的晶振谐波，主要是现在PLL电源特别是里面的CP和VCO没有用单独的电源，电源干扰比较难排除，衬底耦合更不知道从哪里排查了

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