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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 资料共享 › PLL Jitter, PhaseNoise cadence 仿真
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楼主: im2058

[原创] PLL Jitter, PhaseNoise cadence 仿真

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邦邦
发表于 2024-7-12 17:50:35 | 显示全部楼层
本帖最后由 邦邦 于 2024-7-12 17:52 编辑

楼主，您好！请教一下，您这份文件里面PLL， Liner Model testBench是如何建立的？能麻烦您帮忙说明一下吗？
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BINGQING188
发表于 2024-8-8 11:07:23 | 显示全部楼层
感谢
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gladiac
发表于 2024-8-8 15:31:04 | 显示全部楼层
nice information, thanks.
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发表于 2024-8-9 09:25:37 | 显示全部楼层
Thanks
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lzzeng
发表于 2024-8-9 09:40:41 | 显示全部楼层
good good
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tangsongyuan699
发表于 2024-8-11 10:09:59 | 显示全部楼层
谢谢
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cdting
发表于 2024-8-12 04:53:52 | 显示全部楼层
Thanks!!!
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sskidtf
发表于 2024-8-12 09:56:09 | 显示全部楼层
thanks
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chillys
发表于 2024-8-12 10:51:07 | 显示全部楼层
谢谢
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greathhy
发表于 2024-8-12 11:42:49 | 显示全部楼层
感谢分享
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