夏宇闻教授经典系列 RISC CPU

xiexie57 · 发表于 2023-11-28 17:43:48

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敬重的夏宇闻教授经典系列 RISC CPU

从算法设计到硬线逻辑的实现
——— 复杂数字逻辑系统的 V erilog H D L
设计技术和方法

第八章可综合的VerilogHDL设计实例

附 verilog 源码

Outerman2000 · 发表于 2023-11-28 20:36:02

谢谢分享！

zoe0615 · 发表于 2023-11-28 23:04:37

Thank you very much.

andy2000a · 发表于 2023-11-29 08:47:13

cmmjava · 发表于 2023-12-2 23:03:16

感谢分享

igolaps · 发表于 2024-5-22 19:00:51

thanks

真诚的小鲸鱼 · 发表于 2024-10-24 18:06:24

感谢分享

[原创] 夏宇闻教授经典系列 RISC CPU