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楼主: hzmhhp0421

VHDL design representation and synthesis

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yy1111
发表于 2009-9-25 11:18:41 | 显示全部楼层

好文

太好了
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yy1111
发表于 2009-9-25 11:22:04 | 显示全部楼层
xiexie le
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yy1111
发表于 2009-9-25 11:24:21 | 显示全部楼层
谢谢了
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yy1111
发表于 2009-9-25 11:26:54 | 显示全部楼层
好文a 真是
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yy1111
发表于 2009-9-25 11:31:11 | 显示全部楼层
楼主怎么害人啊，还以为是英文版的呢，费了这么多流量下下来竟然是中文版的
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joshstone
发表于 2009-9-25 11:35:18 | 显示全部楼层
thx，好书。
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joshstone
发表于 2009-9-25 11:40:35 | 显示全部楼层
攒币下载
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joshstone
发表于 2009-9-25 11:42:07 | 显示全部楼层
硬件描述语言Verilog
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joshstone
发表于 2009-9-25 11:43:42 | 显示全部楼层
VHDL design representation and synthesis
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joshstone
发表于 2009-9-25 11:45:03 | 显示全部楼层
VHDL design representation and synthesis
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