v2lvs问题

max2022 · 发表于 2022-7-8 12:12:30

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用v2lvs将Verilog转换成SPICE网表时没有成功，有一个warning如下：
Warning: Behavioral Construct in PixelCol_lvs.vams:136 near r <name_of_genvar: YYID> Module PixelCol not translated.
转换的输出文件里只有头，没有具体内容。

136行的内容是"genvar r;"
Verilog中用了generate for loop多次例化一个模块，是不是v2lvs不支持generate？

谢谢！

li441262673 · 发表于 2022-7-8 15:57:18

v2lvs是将门级网表转成spice，而不是将rtl转成spice

max2022 · 发表于 2022-7-18 13:38:47

谢谢回答。我是自己写的門级网表，用到了generate。

汗点瓷 · 发表于 2022-8-12 15:09:23

max2022 发表于 2022-7-18 13:38
谢谢回答。我是自己写的門级网表，用到了generate。

你写好代码dc跑一下再用v2lvs不就没这个问题了

[求助] v2lvs问题

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