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楼主: 0xffff

官方的SystemVerilog testbench tutorial

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头像被屏蔽
发表于 2008-5-31 11:31:18 | 显示全部楼层
提示: 作者被禁止或删除 内容自动屏蔽
发表于 2008-6-1 09:53:46 | 显示全部楼层
thanks
发表于 2008-6-12 11:19:20 | 显示全部楼层
thanks for your shareing
发表于 2008-7-5 10:23:25 | 显示全部楼层

dddddddddddd

ddddddddddddddddddd
 楼主| 发表于 2008-7-6 08:41:27 | 显示全部楼层
自己顶
发表于 2008-7-6 16:38:01 | 显示全部楼层
It is great! Thanks for your sharing!
发表于 2008-7-6 16:53:31 | 显示全部楼层
这也叫官方???
发表于 2008-7-12 09:42:42 | 显示全部楼层

jhljhjhjhjhjhjh

ytytytytyhghghghghgh
发表于 2008-8-29 10:26:20 | 显示全部楼层
所谓官方是说synopsys的?
 楼主| 发表于 2008-8-29 13:58:48 | 显示全部楼层
自己顶,好东西啊
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