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官方的SystemVerilog testbench tutorial

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发表于 2008-1-6 08:44:39 | 显示全部楼层 |阅读模式

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SV testbench的重要性不言而喻,来自官方的文档更具有参考价值。
希望大家喜欢。

svtb_tutorial.pdf

877.45 KB, 下载次数: 327 , 下载积分: 资产 -2 信元, 下载支出 2 信元

 楼主| 发表于 2008-1-6 09:05:06 | 显示全部楼层
赚点小钱,呵呵
发表于 2008-1-6 12:09:11 | 显示全部楼层
我来为大家看看
发表于 2008-1-6 12:24:19 | 显示全部楼层
是synopsys的一个文档,感觉一般,就verification而言,建议还是看mentor的AVM吧
发表于 2008-1-22 18:24:01 | 显示全部楼层
太好了,下载看看
 楼主| 发表于 2008-1-24 08:39:42 | 显示全部楼层
好东西
谢谢楼主
发表于 2008-2-3 04:41:54 | 显示全部楼层
Thanks for your sharing
发表于 2008-5-29 14:09:05 | 显示全部楼层
xiexie
发表于 2008-5-29 20:40:15 | 显示全部楼层
顶楼主,谢谢
头像被屏蔽
发表于 2008-5-31 11:12:44 | 显示全部楼层
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