[求助] 锁相环环路锁定异常

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zjh2001

发表于 2025-1-2 17:13:02 | 显示全部楼层

想问一下各位佬，锁相环环路仿真的时候，要给VCO的输出端设置一个初始条件吗，仿真的时候发现，如果不给初始值的话，环路里的VCO不起振，VCO四端输出，对锁相环环路dc仿真，发现OUT_I为934.5mV,OUT_Q是217.3，单独仿真VCO初始条件设置成这两个值的话也是无法起振。锁相环所有模块都是前辈做的，我是小白，拿来仿真学习用的，各位老看到的话指点一二，不胜感激，有表述不当的地方请各位佬谅解

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