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[原创] Verilog实现UART/RS232/RS485收发自动校调功能,降低接收误码率

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发表于 2020-1-14 12:22:54 | 显示全部楼层 |阅读模式

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本帖最后由 auv0513 于 2020-1-14 12:40 编辑

verilog实现UART/RS232/RS485收发自动校调功能,降低接收误码率
1.UART(RS232/RS485)收发功能。
2.波特率默认为1M,可参数修改,但不能太小,太小的话,计数器宽度需要调整。
3.接收带串口脉冲相位跟踪自动校准功能,可以有效减少串口接收误码的发生。
4.仿真之前要先修改FT3Testing.mpf文件,用notepad++打开,大约再2402行到2418行的目录要改为你解压后实际源文件的目录。
5.fifo使用vivado2017.4建的。仿真QuestaSim10.6c。


问题反馈:QQ:833648



05.png
07.png
03.png
02.png
01.png
06.png

UART.zip

29.38 MB, 下载次数: 184 , 下载积分: 资产 -9 信元, 下载支出 9 信元

源码

发表于 2020-1-14 20:36:32 | 显示全部楼层
thanks
发表于 2020-1-14 23:13:54 | 显示全部楼层
感谢分享原创好文
发表于 2020-1-15 08:15:03 | 显示全部楼层
Thanks
发表于 2020-1-15 09:04:29 | 显示全部楼层
I at 3'th floor.Thanks.
发表于 2020-1-15 22:03:15 | 显示全部楼层
感谢分享原创好文!
发表于 2020-1-20 13:52:22 | 显示全部楼层
楼主是FT3吗?有曼彻斯特编码吗?
发表于 2020-1-22 20:25:04 | 显示全部楼层
谢谢原创好文,描述的也清晰
发表于 2020-1-22 20:26:49 | 显示全部楼层
波特率默认为1M,可参数修改,但不能太小

这句话怎么理解,如果用7200bps这么低的波特率,能行吗? 需要改什么?
发表于 2020-2-19 11:20:59 | 显示全部楼层
Thanks very much
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