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edacw 发表于 2019-12-5 15:57 全部在服务器上试了一下,VCS不管加不加debug选项,仿真时间都是5分钟多些,Xcelium的多核版本仿真时间17 ...
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edacw 发表于 2020-1-2 13:15 嗯,你是说A输出存在race? 用的是A_REG信号,A输出寄存成这个信号了
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