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[求助] spectre仿真网表时报错 ERROR (SFE-45):器件端口没匹配

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发表于 2019-3-13 14:57:01 | 显示全部楼层 |阅读模式

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各位朋友:大家好!

我在用spectre仿真网表时出错,报错信息我一直没有理解,想问问大家有没有类似的经历。

报错信息:
Error found by spectre during hierarchy flattening.
    ERROR (SFE-45): "CombFilter.cdl" 3100: `Xclk_L2_I2': An instance of `CLKINUHDV24' needs at least 4 terminals (but has only 0).

其中`CLKINUHDV24'是一个反相器,有4个端口(输入,输出,电源,地)。网表里面也能看出来是4个端口的连接。但是报错说没有端口。这是什么原因导致的?

有劳各位了
发表于 2019-3-13 15:53:23 | 显示全部楼层
网表是用的spectre语法吗?看上去像没认出端口
 楼主| 发表于 2019-3-13 16:29:39 | 显示全部楼层
回复 2# acging

我做的是一个CIC滤波器,从encounter导出来的spice网表,然后加到仿真用的网表里。

以下就是报错的位置,说CLKINUHDV24这个反相器没有端口。但是我查了一下,前面的器件也是这样的格式,但没报错。

Xclk_L2_I2 CLKINUHDV24 $PINS ZN=clk_L2_N2 I=clk_L1_N0 VDD=VDD VSS=VSS
Xclk_L2_I1 CLKINUHDV24 $PINS ZN=clk_L2_N1 I=clk_L1_N0 VDD=VDD VSS=VSS
Xclk_L2_I0 CLKINUHDV24 $PINS ZN=clk_L2_N0 I=clk_L1_N0 VDD=VDD VSS=VSS
Xclk_L1_I0 CLKINUHDV24 $PINS ZN=clk_L1_N0 I=clk VDD=VDD VSS=VSS
发表于 2019-3-13 19:47:11 | 显示全部楼层
可能网表格式的问题, spectre可能不支持cdl这种格式,
假如CLKINUHDV24 subckt pin order is: ZN  I  VDD  VSS
可以试试把网表改成这样
Xclk_L2_I2 clk_L2_N2 clk_L1_N0 VDD VSS CLKINUHDV24
发表于 2019-3-14 11:34:34 | 显示全部楼层
spice类型的网表貌似不能直接给spectre用。
发表于 2021-3-2 19:27:02 | 显示全部楼层
你好,请问您解决该问题了吗?
发表于 2022-4-26 16:44:29 | 显示全部楼层
遇到了一样的问题
发表于 2022-4-26 17:06:53 | 显示全部楼层
删除原来的器件和仿真cell 重新走一遍导入网表-创建symbol-仿真的过程 问题就消失了
发表于 2023-6-4 10:31:26 | 显示全部楼层
您好,请问楼主问题解决了吗?是使用什么方法解决的呢?
发表于 2023-11-2 21:03:34 | 显示全部楼层
CDL和CDF没有对应起来,对应起来之后再产生pex.netlist,就可以了
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