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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 使用 Makefile+VCS+Verdi 做个简单的 Test Bench
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楼主: yoof2000

[原创] 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

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184255
发表于 2025-5-8 11:43:37 | 显示全部楼层
谢谢分享！
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zkzk233
发表于 2025-5-8 15:13:23 | 显示全部楼层
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发表于 2025-5-8 15:41:13 | 显示全部楼层
学习学习
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发表于 2025-5-8 22:56:33 | 显示全部楼层
谢谢分享！
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yige569
发表于 2025-5-9 11:29:57 | 显示全部楼层
好东西，支持一下
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发表于 2025-5-9 23:28:58 | 显示全部楼层
各个人设计的test-bench都不一样，可以参考
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发表于 2025-5-12 14:14:07 | 显示全部楼层
谢谢分享！
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发表于 2025-5-12 19:18:47 | 显示全部楼层
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发表于 2025-5-17 23:17:49 | 显示全部楼层
谢谢分享！
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发表于 2025-5-21 13:06:15 | 显示全部楼层
学习一下，谢谢
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