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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 使用 Makefile+VCS+Verdi 做个简单的 Test Bench
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楼主: yoof2000

[原创] 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

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发表于 2025-4-13 22:10:49 | 显示全部楼层
Thanks for sharing
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发表于 2025-4-14 19:27:22 | 显示全部楼层
谢谢分享
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发表于 2025-4-17 18:46:29 | 显示全部楼层
我也是超级新手 学习一下
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发表于 2025-4-17 18:58:32 | 显示全部楼层
学习学习
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发表于 2025-4-17 21:09:47 | 显示全部楼层
谢谢分享！
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发表于 2025-4-18 19:10:26 | 显示全部楼层

感谢楼主分享
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发表于 2025-4-21 16:16:20 | 显示全部楼层
看看
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发表于 2025-4-22 09:38:23 | 显示全部楼层
兹磁一下
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发表于 2025-5-7 16:14:37 | 显示全部楼层
感谢分享
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发表于 2025-5-7 21:10:58 | 显示全部楼层
This is a good reference !
Thank you
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