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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 使用 Makefile+VCS+Verdi 做个简单的 Test Bench
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楼主: yoof2000

[原创] 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

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发表于 2022-2-28 15:02:04 | 显示全部楼层
谢谢楼主的分享！
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发表于 2022-2-28 20:27:14 | 显示全部楼层
谢谢
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发表于 2022-3-1 14:36:07 | 显示全部楼层
thanks
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发表于 2022-3-1 19:19:07 | 显示全部楼层
谢谢你的信息，期待新的帖子
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hxj9981
发表于 2022-3-1 23:52:47 | 显示全部楼层
thank you for share
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发表于 2022-3-3 00:01:20 | 显示全部楼层
家一起学习，一起进步。
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发表于 2022-3-7 13:50:03 | 显示全部楼层
我正在找这方面的资料，谢谢！！！！！
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发表于 2022-3-7 16:35:02 | 显示全部楼层
学习一下
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el21t2l
发表于 2022-3-8 08:41:51 | 显示全部楼层
学习一哈
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发表于 2022-3-8 08:51:43 | 显示全部楼层
感谢
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